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本文標(biāo)題："集成電路各層掩膜工藝斷口截面分析顯微鏡"
新聞來源：未知 發(fā)布時(shí)間：2018-9-30 0:42:04 本站主頁地址：http://www.nhgjxq.cn
集成電路各層掩膜工藝斷口截面分析顯微鏡
陣列設(shè)計(jì)技術(shù)
通用性和半通用性的集成電路需要有非�？斓脑O(shè)計(jì)周轉(zhuǎn)時(shí)間，因而產(chǎn)生
了門陣列和晶體管陣列設(shè)計(jì)的思想。門陣列和晶體管陣列的特征是使圓片
通過所有各層掩膜工藝，直至金屬互連層。晶體管陣是由互聯(lián)晶體管組成
的一些基本門。將這些門相互連接起來就完成了整個(gè)電路。而在門陣列中
，作為構(gòu)筑方塊的門已經(jīng)形成了，要做的工作僅是簡(jiǎn)單地把這些門連接起
來。
陣列設(shè)計(jì)技術(shù)有兩個(gè)基本步驟。第一步i是對(duì)所需電路進(jìn)行邏輯模擬，
第二步，用互聯(lián)作圖設(shè)備或自動(dòng)作圖系統(tǒng)來完成電路的分配和布局工作。
過去，門陣列和晶體管陣列設(shè)計(jì)技術(shù)損失了大量的硅面積。但現(xiàn)在已
經(jīng)開發(fā)了具有更有效更復(fù)雜算法的軟件，可以大大減小這個(gè)損失。目前的C
AD系統(tǒng)已包含有產(chǎn)生高密度陣列婚軟件。陣列設(shè)計(jì)方法確實(shí)提供了快速周
轉(zhuǎn)時(shí)間，但由于形成陣列需要一些基本的布局工作，所以仍舊要犧牲一些
電潞面積。這種方法所需的人工干涉應(yīng)保持在最低限度，主要是用于糾正
還沒有很好聯(lián)結(jié)的少部分電路。
硅器件編澤程序
基本思想就是從設(shè)計(jì)開始到結(jié)束，都對(duì)集成電路的宏觀功能和微觀功
能進(jìn)行自動(dòng)定義。如果這可以做封，設(shè)計(jì)所需時(shí)間就會(huì)大大縮短，由硅器
件編譯程序設(shè)計(jì)的電路具有很高的質(zhì)量。
與那種需要詳細(xì)解釋細(xì)節(jié)的低級(jí)語言相比較，硅器件編譯程序相當(dāng)于
高級(jí)、抽象的計(jì)算機(jī)語言。
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